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Codage Variable sur 64 bits en VHDL

Forum Programmation : Codage Variable sur 64 bits en VHDL

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kurp@IDN   14-08-2007 à 12:21:02

Bonjour,
je cherche à coder des signaux sur 64 bits en VHDL, quelqu'un aurait t'il une idée ?

j'ai essayé de faire un type

type int_64 is range 0 to 2^64-1 mais il bloque en me disant que cela dépasse l'entier le plus haut.

Kurp,

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bobstar   20-08-2007 à 12:52:48
- 0 +

salut,
tu peux faire un truc du style :

signal toto : std_logic_vector(63 downto 0);

------------------------------ J'ai révé d'un monde où les femmes étaient nues et muettes ...
 Répondre à bobstar
showie   20-08-2007 à 16:34:17
- 0 +

Salut,

En VHDL un integer peut être étendu seulement jusqu'à 32 bit (et cela dépend de l'implémentation en plus)

donc tu utilises deux entier un de poids fort et un de poids faible

------------------------------ Situation caractéristique, à l'image de la vie, puisqu'il
s'agit de se conformer aux limites imposées par la réalité
tout en laissant la place à l'imaginaire et aux fantasmes
 Répondre à showie
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