synthese d'un sequenceur (vhdl)
Forum Programmation : synthese d'un sequenceur (vhdl)
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salut
veillez m'aidez svp c'est urgent
je dois rendre ce travail demain)
voila mon probleme
on voudrait integrer 2 automates pour realiser un systeme de detection de fanions debut et fin lors d'une transmission de données pour cela j'ai realisé un automate qui reconnait sur les coups d'horloge successifs , la sequence d'entrée
1->1->1->1->1->1->1->1
et j'ai fait la meme chose pour la séquence
0->0->0->0->0->0->0->0
NB: ce travail doit etre fait en langage vhdl
merci beaucoup
